[实用新型]一种用于宽带频率合成器的锁相环电路有效

专利信息
申请号: 202022236482.4 申请日: 2020-10-10
公开(公告)号: CN212572516U 公开(公告)日: 2021-02-19
发明(设计)人: 王玉军;马爽 申请(专利权)人: 成都泰格微波技术股份有限公司
主分类号: H03L7/087 分类号: H03L7/087;H03L7/099
代理公司: 成都巾帼知识产权代理有限公司 51260 代理人: 邢伟
地址: 610000 四*** 国省代码: 四川;51
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摘要:
搜索关键词: 一种 用于 宽带 频率 合成器 锁相环 电路
【说明书】:

实用新型公开了一种用于宽带频率合成器的锁相环电路,包括鉴频鉴相器、电荷泵、环路滤波器、压控振荡器VCO和分频器;所述鉴频鉴相器的源信号输入端Ref接收外部信号Uref,鉴频鉴相器的第一信号输出端Up、第二信号输出端Dn均与电荷泵连接,所述电荷泵的输出端与环路滤波器连接,所述环路滤波器的输出端与压控振荡器VCO连接,由所述压控振荡器VCO对外输出信号,同时,压控振荡器VCO输出的信号通过分频器处理后得到反馈信号Udiv,传输到鉴频鉴相器的反馈输入端Div。本实用新型针对锁相环电路中的鉴频鉴相器,有效避免了鉴相死区的出现,从而保证了锁相环的正常工作。

技术领域

本实用新型涉及锁相环,特别是涉及一种用于宽带频率合成器的锁相环电路。

背景技术

锁相环电路在频率合成器中有着非常广泛的应用,鉴频鉴相器(Phase FrequencyDetector—PFD)是锁相环的关键部件,它的主要功能是检测输入信号与压控振荡器反馈信号的相差和频差,并将它们放大,PFD的性能决定着锁相环的精度和稳定度。

现代鉴相器的设计中,特别是大规模通信和数字集成电路中,人们更多的设计目标是:高速、低功耗,低噪声、无死区和宽线性鉴相范围的CMOS数字鉴相器。当参考信号和反馈信号存在很小的相位误差时,PFD输出脉冲的宽度太窄以至于不能打开后级电荷泵的输入开关管,从而出现鉴相死区,影响锁相环的正常工作。

实用新型内容

本实用新型的目的在于克服现有技术的不足,提供一种用于宽带频率合成器的锁相环电路,针对锁相环电路中的鉴频鉴相器,有效避免了鉴相死区的出现,从而保证了锁相环的正常工作。

本实用新型的目的是通过以下技术方案来实现的:一种用于宽带频率合成器的锁相环电路,包括鉴频鉴相器、电荷泵、环路滤波器、压控振荡器VCO和分频器;

所述鉴频鉴相器包括源信号输入端Ref、反馈输入端Div、第一信号输出端Up、第二信号输出端Dn、延迟组件,以及第一与非门K1~第九与非门K9;

所述鉴频鉴相器的源信号输入端Ref接收外部信号Uref,鉴频鉴相器的第一信号输出端Up、第二信号输出端Dn均与电荷泵连接,所述电荷泵的输出端与环路滤波器连接,所述环路滤波器的输出端与压控振荡器VCO连接,由所述压控振荡器VCO对外输出信号,同时,压控振荡器VCO输出的信号通过分频器处理后得到反馈信号Udiv,传输到鉴频鉴相器的反馈输入端Div;

鉴频鉴相器中:

第一与非门K1的第一输入端连接源信号输入端端Ref,第一与非门K1的第二输入端连接第二与非门K2的输出端,第一与非门K1的输出端分别连接到第二与非门K2的第一输入端、第三与非门K3的第一输入端和第九与非门K9的第一输入端;

第二与非门K2的第二输入端连接到第三与非门K3的输出端,第二与非门K2的第三输入端连接到延迟组件的输出端,第二与非门K2的输出端还与第一信号输出端Up连接;

第三与非门K3的第二输入端与第四与非门K4的输出端连接,第三与非门K3的输出端还分别连接到第四与非门K4的第一输入端和第九与非门K9的第二输入端;第四与非门K4的第二输入端连接到延迟组件的输出端;

第五与非门K5的第一输入端连接到延迟组件的输出端,第五与非门K5的第二输入端连接到第六与非门K6的输出端,第五与非门K5的输出端与第六与非门K6的第一输入端连接;第六与非门K6的第二输入端连接到第八与非门K8的输出端,第六与非门K6的输出端还分别连接到第九与非门K9的第三输入端和第七与非门K7的第二输入端;

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