[发明专利]存储装置组、存储系统以及存储装置的操作方法在审
| 申请号: | 202011383885.X | 申请日: | 2020-12-01 |
| 公开(公告)号: | CN113031855A | 公开(公告)日: | 2021-06-25 |
| 发明(设计)人: | 李庸仁;李斗基 | 申请(专利权)人: | 三星电子株式会社 |
| 主分类号: | G06F3/06 | 分类号: | G06F3/06;G06F13/16;G06F13/42 |
| 代理公司: | 北京铭硕知识产权代理有限公司 11286 | 代理人: | 黄晓燕;张川绪 |
| 地址: | 韩国京畿*** | 国省代码: | 暂无信息 |
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| 摘要: | |||
| 搜索关键词: | 存储 装置 存储系统 以及 操作方法 | ||
提供了存储装置组、存储系统和存储装置的操作方法。存储装置组包括可重构逻辑芯片和存储装置。逻辑芯片包括:重定时器,被配置为通过调整从外部装置接收的输入信号来生成输出信号;以及操作电路,被配置为执行操作功能。存储装置包括:第一端口,连接到重定时器;第二端口,连接到操作电路;以及控制器,被配置为控制经由第一端口和第二端口的数据发送和接收。
本申请要求于2019年12月9日提交到韩国知识产权局的第10-2019-0162880号韩国专利申请的优先权,所述韩国专利申请的公开通过引用全部包含于此。
技术领域
与示例实施例一致的方法和设备涉及存储装置,更具体地,涉及包括存储装置和可重构逻辑芯片的存储装置组、包括存储装置组的存储系统以及存储装置的操作方法。
背景技术
为了提高存储系统的处理速度,可将加速器加到存储系统,加速器通过执行由主机执行的操作中的一些操作来辅助主机的操作。加速器可以是执行设置的功能的专用硬件加速器或根据设计文件(诸如,现场可编程门阵列(FPGA)图像)可重新配置的加速器。近来,由于主机执行各种应用并且针对每个应用要求高速处理,所以对可重构加速器(诸如,根据各种应用可重构的FPGA)的需求正在增加。
发明内容
示例实施例提供一种能够通过使用重定时器执行与主机的通信来最小化输入和输出延迟的存储装置组、包括该存储装置组的存储系统、以及存储装置组的操作方法。
根据示例实施例的一个方面,提供了一种存储装置组,所述存储装置组包括:可重构逻辑芯片,包括:重定时器,被配置为通过调整从外部装置接收的输入信号来生成输出信号,和操作电路,被配置为执行操作功能;以及存储装置,包括:第一端口,连接到重定时器;第二端口,连接到操作电路;和控制器,被配置为控制经由第一端口和第二端口的数据发送和接收。
根据示例实施例的一个方面,提供了一种存储系统,所述存储系统包括:主机;重定时器,与主机可通信地连接;存储装置,包括控制器,存储装置被配置为:经由重定时器从主机接收请求,并且生成与接收的请求对应的输入数据;以及可重构逻辑芯片,被配置为:从存储装置接收输入数据,通过使用输入数据执行与接收的请求对应的操作来生成输出数据,并将输出数据提供到存储装置。
根据示例实施例的一个方面,提供了一种连接到可重构逻辑芯片的存储装置的操作方法,可重构逻辑芯片包括重定时器和操作电路,存储装置包括连接到重定时器的第一端口和连接到操作电路的第二端口,所述操作方法包括:经由第一端口接收主机的请求;生成与接收的请求对应的输入数据;经由第二端口将输入数据提供到操作电路;经由第二端口从操作电路获得与输入数据对应的输出数据;基于输出数据生成与接收的请求对应的响应数据;以及经由第一端口和重定时器向主机发送生成的响应数据。
附图说明
从以下结合附图进行的详细描述,将更清楚地理解以上和其他方面、特征和优点,在附图中:
图1是示意性地示出根据示例实施例的存储系统的框图;
图2是详细示出根据示例实施例的存储装置组的框图;
图3是用于描述根据示例实施例的存储装置组的操作方法的框图;
图4是根据示例实施例的可重构逻辑芯片和控制器的操作的示例的流程图;
图5是根据示例实施例的可重构逻辑芯片和控制器的操作的示例的流程图;
图6是示出根据示例实施例的控制器的配置的框图;
图7是示出根据示例实施例的控制器的配置的框图;
图8是用于描述根据示例实施例的存储装置组的操作方法的框图;
图9是用于描述根据示例实施例的存储装置组的操作方法的框图;
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