[发明专利]缓冲器电路、集成电路及电子设备在审
| 申请号： | 202011284228.X | 申请日： | 2020-11-17 |
| 公开（公告）号： | CN112398467A | 公开（公告）日： | 2021-02-23 |
| 发明（设计）人： | 刘广辉 | 申请（专利权）人： | 维沃移动通信有限公司 |
| 主分类号： | H03K19/003 | 分类号： | H03K19/003 |
| 代理公司： | 北京银龙知识产权代理有限公司 11243 | 代理人： | 许静;黄灿 |
| 地址： | 523863 广东*** | 国省代码： | 广东;44 |
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| 摘要： | |||
| 搜索关键词： | 缓冲器 电路 集成电路 电子设备 | ||
1.一种缓冲器电路，其特征在于，包括M个驱动单元、M个第一开关和M个第二开关，M为大于1的正整数；其中，
所述M个驱动单元的第一端分别通过所述M个第一开关连接电源，并分别通过所述M个第二开关接地，所述M个驱动单元的第二端彼此连接作为所述缓冲器电路的输入端，所述M个驱动单元的第三端彼此连接作为所述缓冲器电路的输出端；
所述M个第一开关和所述M个第二开关用于控制所述M个驱动单元的工作模式，所述M个驱动单元用于对所述缓冲器电路的输入端接收到的信号进行放大，以在所述缓冲器电路的输出端输出所述工作模式对应的驱动能力的驱动信号，所述工作模式用于表征所述M个驱动单元的驱动能力。
2.根据权利要求1所述的缓冲器电路，其特征在于，所述缓冲器电路还包括第一调节子电路；其中，
所述第一调节子电路的输入端与所述缓冲器电路的输入端连接，所述第一调节子电路的输出端与所述M个驱动单元的第二端连接。
3.根据权利要求2所述的电路，其特征在于，所述第一调节子电路为电阻电容电路，所述电阻电容电路用于延缓所述驱动信号的上升沿和下降沿。
4.根据权利要求2所述的缓冲器电路，其特征在于，所述缓冲器电路还包括第三开关，所述第三开关与所述第一调节子电路并联。
5.根据权利要求1至4任一项所述的缓冲器电路，其特征在于，所述缓冲器电路还包括第二调节子电路；其中，
所述第二调节子电路的输入端与所述M个驱动单元的第三端连接，所述第二调节子电路的输出端作为所述缓冲器电路的输出端。
6.根据权利要求5所述的缓冲器电路，其特征在于，所述第二调节子电路为由电阻组成的电路。
7.根据权利要求6所述的缓冲器电路，其特征在于，所述缓冲器电路还包括第四开关，所述第四开关与所述第二调节子电路并联。
8.根据权利要求1所述的缓冲器电路，其特征在于，所述M个驱动单元的第一端分别通过所述M个第一开关连接的电源的电压值均不同。
9.根据权利要求1所述的缓冲器电路，其特征在于，第一驱动单元包括PMOS管和NMOS管，所述第一驱动单元为所述M个驱动单元中任一驱动单元；
所述PMOS管的源极通过第一目标开关连接电源，并通过第二目标开关接地，所述NMOS管的源极接地；其中，所述第一目标开关为所述M个第一开关中任一开关，所述第二目标开关为所述M个第二开关中任一开关；
所述PMOS管的栅极和所述NMOS管的栅极彼此连接作为所述缓冲器电路的输入端，所述PMOS管的漏极和所述NMOS管的漏极彼此连接作为所述缓冲器电路的输出端。
10.一种电子设备，其特征在于，所述电子设备包括时钟发生器和与所述时钟发生器连接的权利要求1至9任一项所述的缓冲器电路。
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