[发明专利]一种FPGA配置存储器在审
| 申请号: | 202010615791.4 | 申请日: | 2020-06-30 |
| 公开(公告)号: | CN111814418A | 公开(公告)日: | 2020-10-23 |
| 发明(设计)人: | 杨献;王海力 | 申请(专利权)人: | 京微齐力(北京)科技有限公司 |
| 主分类号: | G06F30/343 | 分类号: | G06F30/343;G06F30/347;G06F115/06 |
| 代理公司: | 北京亿腾知识产权代理事务所(普通合伙) 11309 | 代理人: | 陈霁 |
| 地址: | 100190 北京市海淀区*** | 国省代码: | 北京;11 |
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| 摘要: | |||
| 搜索关键词: | 一种 fpga 配置 存储器 | ||
1.一种FPGA配置存储器,包括:
多个存储单元,所述多个存储单元在版图上排成一列;所述多个存储单元中的任意一个存储单元与一个字线资源和一组位线资源连接;
所述多个存储单元中包括相邻的第一存储单元和第二存储单元,所述第一存储单元和第二存储单元与同一个字线资源连接,分别由不同的位线资源连接。
2.根据权利要求1所述的存储器,其特征在于,所述存储单元由至少一个MOS管构成。
3.根据权利要求1所述的存储器,其特征在于,当对所述存储器进行写操作时,通过行地址译码器选择一条字线,通过列地址译码器选择与所述字线相连的至少两个存储单元;
将与至少两个存储单元相连的至少两个读写电路控制在写状态,并将输入输出端的数据通过至少两个读写电路写入到至少两个存储单元中。
4.根据权利要求1所述的存储器,其特征在于,当对所述存储器进行读操作时,通过行地址译码器选择一条字线,通过列地址译码器选择与所述字线相连的至少两个存储单元;
将与至少两个存储单元相连的至少两个读写电路控制在读状态,并通过所述至少两个读写电路将与至少两个读写电路相连的至少两个存储单元中数据读出到输入输出端。
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