[发明专利]电平转换电路、显示面板在审
| 申请号: | 202010557500.0 | 申请日: | 2020-06-18 |
| 公开(公告)号: | CN111599299A | 公开(公告)日: | 2020-08-28 |
| 发明(设计)人: | 张银龙;姚树林;孙志华;李琦;马文鹏;胡鹏飞 | 申请(专利权)人: | 京东方科技集团股份有限公司;北京京东方显示技术有限公司 |
| 主分类号: | G09G3/20 | 分类号: | G09G3/20 |
| 代理公司: | 北京律智知识产权代理有限公司 11438 | 代理人: | 王辉;阚梓瑄 |
| 地址: | 100015 *** | 国省代码: | 北京;11 |
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| 摘要: | |||
| 搜索关键词: | 电平 转换 电路 显示 面板 | ||
1.一种电平转换电路,其特征在于,包括:
信号生成电路,包括多个信号输出端,用于通过多个所述信号输出端分别输出驱动信号;
第一运算放大电路,包括多个输入端和与所述输入端一一对应的多个输出端,用于将一输入端的电压进行电平转换并通过与该输入端对应的输出端输出,且所述信号生成电路的信号输出端与所述第一运算放大电路的输入端一一对应连接;
多个开关电路,所述开关电路与所述第一运算放大电路的输入端、所述信号生成电路的信号输出端一一对应设置,所述开关电路连接所述信号生成电路的信号输出端、所第一运算放大电路的输入端、控制信号端,用于响应所述控制信号端的信号连通所述信号生成电路的信号输出端和所第一运算放大电路的输入端;
寄存器,用于存储控制信号组;
控制电路,连接所述寄存器、与多个所述开关电路连接的多个控制信号端,用于根据所述控制信号组控制多个所述开关电路的断通。
2.根据权利要求1所述的电平转换电路,其特征在于,所述寄存器连接一控制信号生成电路,所述控制信号生成电路用于向所述寄存器配置所述控制信号组。
3.根据权利要求1所述的电平转换电路,其特征在于,所述开关电路用于响应高电平信号以连通所述信号生成电路的信号输出端和所第一运算放大电路的输入端;
所述控制信号组包括第一控制信号和第二控制信号,多个所述开关电路包括第一到第十开关电路,所述控制电路包括:
第一与门,第一输入端和第二输入端连接高电平信号端,输出端连接与所述第一到第四开关电路连接的控制信号端;
或门,第一输入端接收所述第一控制信号,第二输出端接收所述第二控制信号,输出端连接与所述第五开关电路、第六开关电路连接的控制信号端;
第二与门,第一输入端接收所述第一控制信号,第二输入端接收所述第一控制信号,输出端连接与第七开关电路、第八开关电路连接的控制信号端;
第三与门,第一输入端接收所述第一控制信号,第二输入端接收所述第二控制信号,输出端连接与第九开关电路、第十开关电路连接的控制信号端。
4.根据权利要求1所述的电平转换电路,其特征在于,所述开关电路包括:
开关晶体管,第一端连接所述所述第一运算放大电路的输入端,第二端连接所述信号生成电路的信号输出端,控制端连接所述控制信号端。
5.根据权利要求1-4任一项所述的电平转换电路,其特征在于,所述电平转换电路应用于显示面板,该显示面板包括栅极驱动电路,所述电平转换电路用于向所述栅极驱动电路提供时钟信号。
6.根据权利要求5所述的电平转换电路,其特征在于,所述显示面板还包括时序控制器,所述信号生成电路用于在所述时序控制器控制下生成所述驱动信号,所述驱动信号为原始时钟时钟信号,所述第一运算放大电路用于对所述原始时钟信号进行电平转换以形成所述时钟信号。
7.根据权利要求6所述的电平转换电路,其特征在于,所述寄存器连接一控制信号生成电路,所述控制信号生成电路共用所述时序控制器。
8.根据权利要求1所述的电平转换电路,其特征在于,所述控制信号组包括多个控制信号,所述寄存器包括多个触发器,每个所述触发器存储有一个所述控制信号。
9.根据权利要求2所述的电平转换电路,其特征在于,所述控制信号生成电路与所述寄存器通过I2C总线连接。
10.根据权利要求5所述的电平转换电路,其特征在于,所述显示面板还包括电源管理电路,所述电源管理电路包括第一低电平输出端、高电平输出端,所述第一运算放大电路的供电端分别连接所述第一低电平输出端和高电平输出端,所述第一运算放大电路还包括低电平输出端。
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