[发明专利]鳍式场效晶体管应力工程优化及其的制作方法有效

专利信息
申请号: 202010145945.8 申请日: 2020-03-05
公开(公告)号: CN111403285B 公开(公告)日: 2023-08-11
发明(设计)人: 鲍宇 申请(专利权)人: 上海华力集成电路制造有限公司
主分类号: H01L21/336 分类号: H01L21/336;H01L29/78
代理公司: 上海浦一知识产权代理有限公司 31211 代理人: 张彦敏
地址: 201203 上海市浦*** 国省代码: 上海;31
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摘要:
搜索关键词: 鳍式场效 晶体管 应力 工程 优化 及其 制作方法
【说明书】:

发明涉及一种鳍式场效晶体管应力工程优化方法和鳍式场效晶体管的制作方法,涉及半导体制造技术,在鳍式场效晶体管的后栅工艺中,通过离子注入工艺形成包括非晶硅和多晶硅的双层结构的伪栅极结构,非晶硅构成鳍结构的侧墙,由非晶硅构成的侧墙退火体积膨胀产生压应力,在垂直方向挤压鳍结构,缓解鳍结构的侧壁呈上窄下宽的结构而造成沟道性能差异的问题,而提高鳍式场效晶体管的性能。

技术领域

本发明涉及半导体制造技术,尤其涉及一种鳍式场效晶体管应力工程优化方法和鳍式场效晶体管的制作方法。

背景技术

在半导体技术领域,为了跟上摩尔定律的脚步,MOSFET晶体管的特征尺寸在不断地缩小。随着半导体器件的尺寸按比例缩小,器件沟道长度缩短,漏极与源极的距离也随之缩短,出现了阈值电压随沟道长度减小而下降,漏电流增加等问题,也即,在半导体器件中产生了短沟道效应。

上述挑战导致了鳍片场效应晶体管,即FinFET的发展,例如,业界在14nm开始采用鳍式场效应晶体管(FinFET,Fin Field-Effect Transistor)结构。即平面CMOS晶体管向三维(3D)鳍式场效应晶体管(Fin Field Effect Transistor,FinFET)器件结构过渡。在FinFET中,栅至少可以从两侧对超薄体进行控制,具有比平面MOSFET器件强得多的栅对沟道的控制能力,能够很好的抑制短沟道效应。

一般的,在FinFET中为了利于填充,鳍(Fin)结构的侧壁会有一定角度,呈上窄下宽的结构,然而此结构会造成沟道性能的差异,且容易产生漏电现象,而影响鳍式场效应晶体管的性能。

发明内容

本发明提供的一种鳍式场效晶体管应力工程优化方法,包括:S1:在半导体衬底上形成鳍结构;S2:沉积第一层多晶硅层,所述第一层多晶硅层覆盖所述半导体衬底的上表面及所述鳍结构的上表面和侧面;S3:对所述第一层多晶硅进行离子注入工艺,形成非晶硅层;S4:对所述非晶硅层进行光刻刻蚀工艺,以形成所述鳍结构的非晶硅侧墙结构;S5:沉积第二层多晶硅层,所述第二层多晶硅层覆盖所述半导体衬底的上表面、所述鳍结构的上表面和侧表面及所述非晶硅侧墙结构的上表面和侧表面,然后对所述第二层多晶硅层进行平坦化工艺,并通过光刻刻蚀工艺形成伪栅极结构;以及S6:进行高温退火工艺使得所述非晶硅侧墙结构中的非晶硅向多晶化转变。

更进一步的,在步骤S1中,在半导体衬底上还形成一层绝缘埋层,然后在绝缘埋层上形成所述鳍结构。

更进一步的,在步骤S2中,所述第一层多晶硅层的厚度大于10nm。

更进一步的,在步骤S3中,所述离子注入工艺的离子注入的材料为Ge或Ar。

更进一步的,在步骤S3中,所述离子注入工艺的离子注入深度小于或等于所述第一层多晶硅的厚度。

更进一步的,在步骤S4中,所述非晶硅侧墙结构的高度为所述鳍结构的高度的10%至100%之间。

更进一步的,在步骤S5中,所述平坦化工艺为化学机械研磨工艺。

更进一步的,步骤S6中,所述高温退火工艺的退火温度大于600℃。

更进一步的,步骤S6中,所述高温退火工艺的氛围为惰性气体氛围。

更进一步的,步骤S6中,所述高温退火工艺的退火时间大于1s。

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