[发明专利]多通道HDLC同步串口总线设备数据通信装置和方法有效
| 申请号： | 202010048920.6 | 申请日： | 2020-01-16 |
| 公开（公告）号： | CN111290985B | 公开（公告）日： | 2021-07-23 |
| 发明（设计）人： | 兰鹏涛;龚小进;徐元;刘嘉祥 | 申请（专利权）人： | 湖北三江航天红峰控制有限公司 |
| 主分类号： | G06F13/42 | 分类号： | G06F13/42 |
| 代理公司： | 北京汇信合知识产权代理有限公司 11335 | 代理人： | 王维新 |
| 地址： | 432000*** | 国省代码： | 湖北;42 |
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| 摘要： | |||
| 搜索关键词： | 通道 hdlc 同步 串口 总线 设备 数据通信 装置 方法 | ||
1.一种多通道HDLC同步串口总线设备数据通信装置，其特征在于，包括：ARM处理器、FPGA、FSMC总线和HDLC串口总线；
所述ARM处理器与所述FPGA通过所述FSMC总线实现通信连接；
所述FPGA设置有FIFO用于存储命令包和应答包，所述FPGA设置有多个通道的HDLC IP核分别与对应通道的所述HDLC串口总线相连接；
所述FIFO包括写FIFO和读FIFO，所述写FIFO用于存储所述ARM处理器通过所述FSMC总线发送至所述FPGA的命令包，所述读FIFO用于存储通过所述HDLC串口总线接收到的数据；
所述命令包和所述应答包中包括通道号，所述FPGA根据所述通道号将所述命令包缓存至对应通道的所述写FIFO中，将所述应答包缓存至对应通道的所述读FIFO中。
2.根据权利要求1所述的多通道HDLC同步串口总线设备数据通信装置，其特征在于，所述FIFO的深度为2048。
3.一种多通道HDLC同步串口总线设备数据通信方法，应用于如权利要求1所述的多通道HDLC同步串口总线设备数据通信装置上，其特征在于，包括：
ARM处理器通过FSMC总线向FPGA发送命令信号和数据；
所述FPGA将所述数据缓存至FIFO中，并调用多个HDLC IP核将FIFO中的数据通过对应通道的HDLC串口总线发送出去；
所述FPGA将通过所述HDLC串口总线接收到的数据缓存至对应通道的FIFO中，并由所述ARM处理器通过所述FSMC总线读取；
其中，所述ARM处理器通过所述FSMC总线向所述FPGA发送命令包，并发送中断信号以通知所述FPGA执行命令；
所述FPGA执行命令后向所述ARM处理器返回应答包，并发送中断信号以通知所述ARM处理器命令执行完毕；
所述FPGA将所述命令包缓存至写FIFO中，并调用所述HDLC IP核将所述写FIFO中的数据组包后通过对应通道的所述HDLC串口总线发送；
所述FPGA将通过所述HDLC串口总线接收到的数据缓存至读FIFO中，并向所述ARM处理器发送中断信号以通知所述ARM处理器通过所述FSMC总线读取所述读FIFO中的数据；
其中，所述命令包和所述应答包中包括通道号，所述FPGA根据所述通道号将所述命令包缓存至对应通道的所述写FIFO中，将所述应答包缓存至对应通道的所述读FIFO中。
4.根据权利要求3所述的多通道HDLC同步串口总线设备数据通信方法，其特征在于，所述FIFO的深度为2048。
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