[发明专利]可编程集成电路的分层局部重构在审
| 申请号: | 201980048365.2 | 申请日: | 2019-07-19 |
| 公开(公告)号: | CN112437925A | 公开(公告)日: | 2021-03-02 |
| 发明(设计)人: | 余豪;R·孔;B·S·马丁;刘俊 | 申请(专利权)人: | 赛灵思公司 |
| 主分类号: | G06F30/343 | 分类号: | G06F30/343;G06F15/78 |
| 代理公司: | 北京市金杜律师事务所 11256 | 代理人: | 王茂华;傅远 |
| 地址: | 美国加利*** | 国省代码: | 暂无信息 |
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| 摘要: | |||
| 搜索关键词: | 可编程 集成电路 分层 局部 | ||
用于集成电路的分层局部重构包括:使用计算机硬件将电路设计的第一局部重构模块转换为(415)第一局部重构容器,其中电路设计被布局和布线;使用计算机硬件将第一网表加载(420)到第一局部重构容器中,其中第一网表包括第一多个局部重构模块,该第一多个局部重构模块最初是空的;并且使用计算机硬件在第一多个局部重构模块中的每个局部重构模块内包括(435)另一网表。使用计算机硬件,实现(440)第一局部重构容器,其中在第一局部重构容器内实现第一多个局部重构模块。
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技术领域
本公开涉及集成电路(IC),更具体地涉及可编程IC的局部重构。
背景技术
可编程集成电路(IC)是指包括可编程电路系统的一种IC。可编程IC的一个示例为现场可编程门阵列(FPGA)。FPGA的特征在于包括可编程电路块。可编程电路块的示例包括但不限于输入/输出块(IOB)、可配置逻辑块(CLB)、专用随机存取存储块(BRAM)、乘法器、数字信号处理块(DSP)、处理器、时钟管理器、以及延迟锁定环(DLL)。通过将配置比特流加载到可编程IC的配置存储器中,电路设计可以在可编程IC的可编程电路内被物理实现。
局部重构是一种过程,其中可以通过将局部配置比特流加载到可编程IC中来动态重构可编程IC内被称为“局部重构区域”或“PR区域”的可编程电路系统区域。该局部配置比特流可以指定与先前在PR区域中实现的电路系统不同的电路系统。部分配置比特流没有为PR区域之外的可编程电路系统的各个部分指定新电路系统和/或不同电路系统。PR区域可以通过局部重构来重复进行修改,例如,为PR区域加载局部配置比特流,其中不同局部配置比特流指定不同电路系统(或应用),而被称为“静态电路系统”或“静态区域”的可编程IC的可编程电路系统的其他区域继续操作而不会中断。
当使用具有PR区域的电路设计时,PR区域的各种特点保持恒定。虽然PR区域内的电路系统可能会使用局部重构技术随时间的推移发生改变,但是PR区域的边界可能不会改变。如此,诸如PR区域的大小、PR区域的形状、PR区域与其他电路系统的连接性以及PR区域的数目之类的某些特点在可编程IC内保持不变。
发明内容
在一个或多个实施例中,一种方法可以包括:使用计算机硬件将电路设计的第一局部重构模块转换为第一局部重构容器,其中电路设计被布局和布线;使用计算机硬件将第一网表加载到第一局部重构容器中,其中第一网表包括第一多个局部重构模块,这些模块最初是空的;使用计算机硬件在第一多个局部重构模块的每个局部重构模块中包括另一网表;以及使用计算机硬件实现第一局部重构容器以及该第一局部重构容器内的第一多个局部重构模块。
在一个或多个实施例中,一种方法可以包括:在可编程集成电路的静态区域内实现第一电路系统,该第一电路系统由第一局部比特流指定;在可编程集成电路的局部重构容器区域内实现第二电路系统,该第二电路系统由第二局部比特流指定;以及在局部重构容器区域内包含的第一局部重构区域内实现第三电路系统并且在局部重构容器区域内包含的第二局部重构区域内实现第四电路系统,其中第三电路系统由第三局部比特流指定,并且第四电路系统由第四局部比特流指定。
在一个或多个实施例中,一种集成电路可以包括静态区域,该静态区域包括第一可编程电路系统,该第一可编程电路系统被配置为实现与外部设备的接口;以及局部重构容器区域,该局部重构容器区域耦合到静态区域,该局部重构容器区域使用第二可编程电路系统实现对静态区域的接口。局部重构容器区域可以包括第一多个局部重构区域,其中第一多个局部重构区域中的至少一个局部重构区域被耦合到局部重构容器区域。
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