[发明专利]用于可配置空间加速器中的集成性能监视的装置、方法和系统在审
| 申请号: | 201980006885.7 | 申请日: | 2019-02-28 |
| 公开(公告)号: | CN111566623A | 公开(公告)日: | 2020-08-21 |
| 发明(设计)人: | 小克尔敏·E·弗莱明;小西蒙·C·史迪力;J·唐 | 申请(专利权)人: | 英特尔公司 |
| 主分类号: | G06F11/34 | 分类号: | G06F11/34;G06F11/30 |
| 代理公司: | 上海专利商标事务所有限公司 31100 | 代理人: | 陈依心;何焜 |
| 地址: | 美国加利*** | 国省代码: | 暂无信息 |
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| 摘要: | |||
| 搜索关键词: | 用于 配置 空间 加速器 中的 集成 性能 监视 装置 方法 系统 | ||
1.一种装置,包括:
处理元件的空间阵列,所述处理元件的空间阵列包括用于接收包括多个节点的数据流图的输入的第一网络,其中,所述数据流图用于被叠加到所述处理元件的空间阵列中,其中每个节点被表示为所述处理元件的空间阵列中的数据流操作器,并且所述处理元件的空间阵列用于当相应的传入操作数集到达所述数据流操作器中的每个数据流操作器时执行操作;
第一性能监视电路,所述第一性能监视电路由第二网络耦合至所述处理元件中的第一多个处理元件,以接收来自所述处理元件中的所述第一多个处理元件中的每个处理元件的至少一个监视值,基于来自所述处理元件中的所述第一多个处理元件中的每个处理元件的所述至少一个监视值生成第一经聚合的监视值,并且当第一阈值被所述第一经聚合的监视值超过时在第三网络上将所述第一经聚合的监视值发送到性能管理器电路;以及
所述性能管理器电路,所述性能管理器电路用于基于所述第一经聚合的监视值执行动作。
2.如权利要求1所述的装置,进一步包括第二性能监视电路,所述第二性能监视电路由第四网络耦合至所述处理元件中的不同的第二多个处理元件,以接收来自所述处理元件中的所述不同的第二多个处理元件中的每个处理元件的至少一个监视值,基于来自所述处理元件中的所述不同的第二多个处理元件中的每个处理元件的至少一个监视值生成第二经聚合的监视值,并且当第二阈值被所述第二经聚合的监视值超过时在所述第三网络上将所述第二经聚合的监视值发送到所述性能管理器电路,其中所述性能管理器电路用于基于所述第一经聚合的监视值和所述第二经聚合的监视值执行动作。
3.如权利要求1所述的装置,其中,所述第一性能监视电路包括匹配电路,所述匹配电路耦合至所述第二网络,以提供来自所述处理元件中的所述第一多个处理元件中的每个处理元件的多个监视值的适当子集,并且基于所述多个监视值的所述适当子集生成所述第一经聚合的监视值。
4.如权利要求3所述的装置,其中,所述第一性能监视电路包括寄存器,所述寄存器用于存储用于耦合至所述处理元件中的所述第一多个处理元件中的每个处理元件的切换装置的控制值,以使所述切换装置基于所述控制值选择所述适当子集。
5.如权利要求1所述的装置,其中,所述第一性能监视电路包括到所述处理元件中的所述第一多个处理元件中的每个处理元件的停止路径,所述停止路径用于当所述第一性能监视电路将所述第一经聚合的监视值发送到所述性能管理器电路时,停止所述处理元件中的所述第一多个处理元件中的每个处理元件。
6.如权利要求1所述的装置,其中,所述第一性能监视电路包括到所述处理元件中的所述第一多个处理元件中的每个处理元件的停止路径,所述停止路径用于当所述第一性能监视电路接收到来自所述性能管理器电路的转储清除值时,停止所述处理元件中的所述第一多个处理元件中的每个处理元件。
7.如权利要求1所述的装置,进一步包括请求地址文件电路,所述请求地址文件电路耦合至所述处理元件的空间阵列和高速缓存存储器,所述请求地址文件电路用于:
响应于来自所述处理元件的空间阵列的对数据访问的请求,经由所述第三网络访问所述高速缓存存储器中的数据,并且
响应于从所述第一性能监视电路接收到所述第一经聚合的监视值,在所述第三网络上将所述第一经聚合的监视值发送到所述性能管理器电路。
8.如权利要求7所述的装置,其中,所述请求地址文件电路包括异常管理器电路,所述异常管理器电路用于用标签标记所述第一经聚合的监视值,所述标签指示所述第一经聚合的监视值要被发送至所述性能管理器电路。
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