[发明专利]半导体装置及其制造方法在审
| 申请号: | 201910736542.8 | 申请日: | 2019-08-09 |
| 公开(公告)号: | CN110854024A | 公开(公告)日: | 2020-02-28 |
| 发明(设计)人: | 秦正起;崔朱逸;郑泰和;藤崎纯史 | 申请(专利权)人: | 三星电子株式会社 |
| 主分类号: | H01L21/48 | 分类号: | H01L21/48;H01L23/488 |
| 代理公司: | 北京天昊联合知识产权代理有限公司 11112 | 代理人: | 赵南;张青 |
| 地址: | 韩国*** | 国省代码: | 暂无信息 |
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| 摘要: | |||
| 搜索关键词: | 半导体 装置 及其 制造 方法 | ||
公开了半导体装置及其制造方法。该方法包括:提供半导体衬底;在半导体衬底的顶表面上形成再分布线;和形成钝化层以覆盖半导体衬底的顶表面上的再分布线。形成再分布线包括:在半导体衬底的顶表面上形成再分布线的第一区段的第一阶段,以及在再分布线的第一区段上形成再分布线的第二区段的第二阶段。再分布线的第二区段的平均晶粒尺寸小于再分布线的第一区段的平均晶粒尺寸。
相关申请的交叉引用
该非临时申请要求于2018年8月20日在韩国知识产权局提交的韩国专利申请No.10-2018-0096751的优先权,其全部内容通过引用结合于此。
技术领域
本发明构思涉及半导体装置和/或其制造方法,并且更具体地,涉及包括再分布层的半导体装置和/或制造该半导体装置的方法。
背景技术
半导体装置由于其小尺寸、多功能性和/或低制造成本而在电子工业中是有益的。随着电子工业的发展,半导体装置变得高度集成。
为了更高的集成度,正在减小半导体装置的图案的线宽。然而,需要新的和/或廉价的曝光技术来限定更精细的图案。因此,难以高度集成半导体装置。因此,已经对新的集成技术进行了各种研究。
随着半导体装置中的性能和集成的进步,已经开发了用于制造具有较高信号传输速率和紧凑尺寸的半导体装置或封装件的技术。例如,再分布线被用于减小尺寸并增加半导体装置的电气特性。
发明内容
本发明构思的一些示例实施例提供了具有改进的结构稳定性的半导体装置和/或制造该半导体装置的方法。
本发明构思的一些示例实施例提供了制造半导体装置的方法,其使得工艺更加便利。
根据本发明构思的示例实施例,制造半导体装置的方法可包括:提供半导体衬底;在半导体衬底的顶表面上形成再分布线;以及形成钝化层以覆盖半导体衬底的顶表面上的再分布线。形成再分布线可包括:在半导体衬底的顶表面上形成再分布线的第一区段的第一阶段,和在再分布线的第一区段上形成再分布线的第二区段的第二阶段。再分布线的第二区段的平均晶粒尺寸可以小于再分布线的第一区段的平均晶粒尺寸。
根据本发明构思的示例实施例,半导体装置可包括:半导体衬底;再分布线,其位于半导体衬底的顶表面上,再分布线包括在半导体衬底的顶表面上的第一区段和在第一区段的顶表面上的第二区段;钝化层,其覆盖半导体衬底的顶表面上的再分布线;以及焊盘,其位于钝化层上,焊盘穿透钝化层并与再分布线接触。再分布线的第二区段的平均晶粒尺寸可以小于再分布线的第一区段的平均晶粒尺寸。
附图说明
图1示出了示出根据本发明构思的示例实施例的半导体装置的剖面图。
图2示出了示出图1中的部分II的放大视图。
图3示出了根据示例实施例的捕获第一区段的顶表面的照片。
图4示出了根据示例实施例的捕获第二区段的顶表面的照片。
图5至图14示出了示出根据本发明构思的示例实施例的制造半导体装置的方法的剖面图。
图15示出了示出在使用阶梯式电镀工艺(step plating process)形成晶粒的同时电流密度与晶粒密度之间的关系的曲线图。
具体实施方式
虽然在示例实施例的描述中使用术语“相同”,但应理解可存在一些误差。因此,当一个元件被称为与另一个元件相同时,应理解,一个元件在期望的制造公差范围(例如,±10%)内与另一个元件相同。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造





