[发明专利]一种用于制造高密度MRAM的自对准互联方法有效
| 申请号: | 201810049346.9 | 申请日: | 2018-01-18 |
| 公开(公告)号: | CN108376690B | 公开(公告)日: | 2020-12-29 |
| 发明(设计)人: | 曹凯华;赵巍胜;崔虎山;赵超 | 申请(专利权)人: | 北京航空航天大学 |
| 主分类号: | H01L27/22 | 分类号: | H01L27/22;H01L21/768 |
| 代理公司: | 北京慧泉知识产权代理有限公司 11232 | 代理人: | 王顺荣;唐爱华 |
| 地址: | 100191*** | 国省代码: | 北京;11 |
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| 摘要: | |||
| 搜索关键词: | 一种 用于 制造 高密度 mram 对准 方法 | ||
1.一种用于制造高密度MRAM的自对准互联方法,其特征在于:该方法包括如下步骤:
步骤一、沉积底导电电极层、MTJ元件层及金属掩膜层;
步骤二、制备柱形MTJ元件,原位沉积用于保护柱形MTJ元件的第一电介质保护层;
步骤三、沉积用于填充柱形MTJ元件阵列间隙的第二电介质保护层;
步骤四、整平第二电介质保护层,暴露柱形MTJ元件上方的第一电介质保护层;
步骤五、同时蚀刻第一、第二电介质保护层,暴露柱形MTJ元件上方的金属掩膜层,自对准的在柱形MTJ元件上方形成第二接触孔;
步骤六、沉积上导电层;
所述步骤二进一步包含制备柱形MTJ元件时,底导电电极层被去除形成底导电电极的步骤;
在所述步骤四之后,步骤五之前,进一步包括在柱形MTJ元件一侧的第二电介质保护层上形成第三掩膜的步骤。
2.根据权利要求1所述的一种用于制造高密度MRAM的自对准互联方法,其特征在于:所述的第一电介质保护层与第二电介质保护层采用不同材料。
3.根据权利要求1所述的一种用于制造高密度MRAM的自对准互联方法,其特征在于:金属掩膜层的材料由钽Ta、氮化钽TaN、钛Ti、氮化钛TiN、钨W、或钌Ru形成,采用物理气相沉积或等离子增强化学气相沉积工艺来形成金属掩膜层。
4.根据权利要求1所述的一种用于制造高密度MRAM的自对准互联方法,其特征在于:所述第一电介质保护层采用等离子增强化学气相沉积、物理气相沉积或电子束蒸镀工艺淀积;第一电介质保护层由氮化硅Si3N4或氧化铝Al2O3的电介质材料形成。
5.根据权利要求1所述的一种用于制造高密度MRAM的自对准互联方法,其特征在于:所述第二电介质保护层的采用等离子增强化学气相沉积、物理气相沉积或电子束蒸镀工艺淀积;第二电介质保护层由氧化硅、氮氧化硅SiON、氧化钽Ta2O5或氧化铪HfO2的电介质材料组成。
6.根据权利要求1所述的一种用于制造高密度MRAM的自对准互联方法,其特征在于:所述整平第二电介质保护层的步骤包括用化学机械抛光、电化学机械抛光或者离子研磨的半导体工业内的平坦化工艺,来去除部分第二电介质保护层,以部分暴露柱形MTJ元件上方第一电介质保护层。
7.根据权利要求1所述的一种用于制造高密度MRAM的自对准互联方法,其特征在于:所述蚀刻第一电介质保护层的步骤包括干法刻蚀、反应离子刻蚀、湿法腐蚀的去除工艺,去除已经暴露的第一电介质保护层,自对准地在柱形MTJ元件上形成接触孔。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L27-00 由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
H01L27-01 .只包括有在一公共绝缘衬底上形成的无源薄膜或厚膜元件的器件
H01L27-02 .包括有专门适用于整流、振荡、放大或切换的半导体组件并且至少有一个电位跃变势垒或者表面势垒的;包括至少有一个跃变势垒或者表面势垒的无源集成电路单元的
H01L27-14 . 包括有对红外辐射、光、较短波长的电磁辐射或者微粒子辐射并且专门适用于把这样的辐射能转换为电能的,或适用于通过这样的辐射控制电能的半导体组件的
H01L27-15 .包括专门适用于光发射并且包括至少有一个电位跃变势垒或者表面势垒的半导体组件
H01L27-16 .包括含有或不含有不同材料结点的热电元件的;包括有热磁组件的





