[发明专利]一种GOA电路及显示装置在审
| 申请号: | 201710769978.8 | 申请日: | 2017-08-29 |
| 公开(公告)号: | CN107331366A | 公开(公告)日: | 2017-11-07 |
| 发明(设计)人: | 曾勉 | 申请(专利权)人: | 深圳市华星光电半导体显示技术有限公司 |
| 主分类号: | G09G3/36 | 分类号: | G09G3/36 |
| 代理公司: | 深圳市威世博知识产权代理事务所(普通合伙)44280 | 代理人: | 钟子敏 |
| 地址: | 518000 广东省深*** | 国省代码: | 广东;44 |
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| 摘要: | |||
| 搜索关键词: | 一种 goa 电路 显示装置 | ||
技术领域
本发明涉及显示技术领域,尤其是涉及一种GOA电路及显示装置。
背景技术
GOA(Gate Driver On Array),也就是利用现有薄膜晶体管(TFT,Thin Film Transistor)液晶显示器的Array(阵列)制程将Gate(扫描)行扫描驱动信号电路制作在Array基板上,实现对Gate逐行扫描的驱动方式的一项技术。
现有的GOA电路由多个TFT组成。而TFT在长时间工作后,其阈值电压Vth容易发生偏移,特别针对IGZO(Indium Gallium Zinc Oxide,氧化铟镓锌)类型的TFT,其电性在T0的时候,Vth也可能会小于0,而且其电性的亚阈值摆幅(S因子)值一般比较小,所以当TFT的栅极和源极之间的电压,即Vgs=0的时候,其TFT的漏电会非常大而导致GOA电路失效。
发明内容
本发明主要解决的技术问题是提供一种GOA电路及显示装置,能够控制GOA电路中的TFT的Vth偏移,减小其漏电,从而增加整个GOA电路的可靠性。
为解决上述技术问题,本发明采用的一个技术方案是:提供一种GOA电路,GOA电路包括多个级联的GOA单元,其中,每一级GOA单元对应驱动一级扫描线,每一级GOA单元包括上拉电路、上拉控制电路、下拉电路和下拉维持电路,其中:上拉电路与上拉控制电路电连接,上拉控制电路向上拉电路提供开启控制信号,上拉电路根据开启控制信号输出当前级别的扫描驱动信号给当前级别的扫描线;下拉电路包括第一下拉开关,第一下拉开关接收下一级的扫描驱动信号,并根据下一级的扫描驱动信号将当前级别的扫描驱动信号拉低为低电平;下拉维持电路包括第一下拉维持开关,第一下拉维持开关接收下拉维持信号,并根据下拉维持信号将当前级别的扫描驱动信号维持为低电平;其中,第一下拉开关和第一下拉维持开关为双栅极TFT开关,双栅极TFT开关包括底栅电极和顶栅电极,其中,顶栅电极接收第一直流电压,以控制双栅极TFT开关的阈值电压偏移。
为解决上述技术问题,本发明采用的另一个技术方案是:提供一种显示装置,该显示装置包括阵列基板,阵列基板包括前文任一项所述的GOA电路。
本发明的有益效果是:区别于现有技术的情况,本发明提供一种GOA电路及显示装置,该GOA电路包括多个级联的GOA单元,其中,每一级GOA单元对应驱动一级扫描线,每一级GOA单元包括上拉电路、上拉控制电路、下拉电路和下拉维持电路。其中,上拉电路与上拉控制电路电连接,上拉控制电路向上拉电路提供开启控制信号,上拉电路根据开启控制信号输出当前级别的扫描驱动信号给当前级别的扫描线,下拉电路包括第一下拉开关,第一下拉开关接收下一级的扫描驱动信号,并根据下一级的扫描驱动信号将当前级别的扫描驱动信号拉低为低电平,下拉维持电路包括第一下拉维持开关,第一下拉维持开关接收下拉维持信号,并根据下拉维持信号将当前级别的扫描驱动信号维持为低电平,其中,第一下拉开关和第一下拉维持开关为双栅极TFT开关,双栅极TFT开关包括底栅电极和顶栅电极,其中,顶栅电极接收第一直流电压,以控制双栅极TFT开关的阈值电压偏移。因此,本发明能够控制GOA电路中的TFT的Vth偏移,减小其漏电,从而增加整个GOA电路的可靠性。
附图说明
图1是本发明实施例提供的一种显示装置的结构示意图;
图2是本发明实施例提供的一种阵列基板的结构示意图;
图3是本发明实施例提供的一种GOA电路的其中一级GOA单元的结构示意图;
图4是图3所示的GOA单元中的双栅极TFT开关的电路结构示意图;
图5是图3所示的GOA单元中的双栅极TFT开关的剖面结构示意图;
图6是图3所示的GOA单元中的各驱动信号的波形示意图;
图7是本发明实施例提供的另一种GOA电路的其中一级GOA单元的结构示意图。
图8是图7所示的GOA单元中的各驱动信号的波形示意图。
具体实施方式
请参阅图1,图1是本发明实施例提供的一种显示装置的结构示意图。如图1所示,本实施例的显示装置100包括彩膜基板101、阵列基板102以及液晶层103。其中,彩膜基板101和阵列基板102相对设置,液晶层103设置在彩膜基板101和阵列基板102之间。
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