[发明专利]半导体结构的形成方法有效
| 申请号: | 201610664696.7 | 申请日: | 2016-08-12 |
| 公开(公告)号: | CN107731739B | 公开(公告)日: | 2020-03-10 |
| 发明(设计)人: | 张城龙;何其暘;王彦 | 申请(专利权)人: | 中芯国际集成电路制造(上海)有限公司;中芯国际集成电路制造(北京)有限公司 |
| 主分类号: | H01L21/768 | 分类号: | H01L21/768 |
| 代理公司: | 北京集佳知识产权代理有限公司 11227 | 代理人: | 高静;吴敏 |
| 地址: | 201203 *** | 国省代码: | 上海;31 |
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| 摘要: | |||
| 搜索关键词: | 半导体 结构 形成 方法 | ||
1.一种半导体结构的形成方法,其特征在于,包括:
提供基底,所述基底包括器件区域和围绕所述器件区域的外围区域,所述器件区域基底和外围区域基底中均形成有底层金属互连结构;
在所述基底上形成介质层;
在所述外围区域介质层内形成第一凹槽,所述第一凹槽具有第一深度;
在所述器件区域介质层内形成第二凹槽,所述第二凹槽具有第二深度,且所述第二深度值大于所述第一深度值;
刻蚀所述第二凹槽底部和侧壁的介质层以及第一凹槽底部的介质层,在器件区域介质层内形成露出所述底层金属互连结构的第一开口,在外围区域介质层内形成露出所述底层金属互连结构的第二开口;
向所述第一开口内填充导电材料,形成第一金属互连结构,向所述第二开口内填充导电材料,形成第二金属互连结构;
在所述基底上形成介质层的步骤包括:在所述基底上形成介电层;
在所述介电层上形成氧化层;
在所述氧化层上形成图形化的硬掩膜层,所述器件区域的硬掩膜层内具有第一掩膜开口,所述外围区域的硬掩膜层内具有第二掩膜开口;
刻蚀所述第二凹槽底部和侧壁的介质层以及第一凹槽底部的介质层的步骤中,以所述图形化的硬掩膜层为掩膜进行刻蚀。
2.如权利要求1所述的半导体结构的形成方法,其特征在于,所述第一深度值和第二深度值的比值为0.2至0.8。
3.如权利要求1所述的半导体结构的形成方法,其特征在于,在器件区域介质层内形成露出所述底层金属互连结构的第一开口的步骤中,所述第一开口包括相互贯通的沟槽和通孔,所述沟槽底部和通孔顶部相连通且所述沟槽开口尺寸大于所述通孔开口尺寸。
4.如权利要求3所述的半导体结构的形成方法,其特征在于,提供基底后,在所述基底上形成介质层之前,所述形成方法还包括:在所述基底上形成刻蚀阻挡层;
在所述基底上形成介质层的步骤中,在所述刻蚀阻挡层上形成所述介质层。
5.如权利要求4所述的半导体结构的形成方法,其特征在于,形成所述第一开口和第二开口的步骤包括:对所述第二凹槽底部和侧壁的介质层以及第一凹槽底部的介质层进行主刻蚀工艺,直至露出所述刻蚀阻挡层;在器件区域介质层内形成相互贯通的沟槽和初始通孔,在外围区域介质层内形成初始开口;其中所述沟槽底部和初始通孔顶部相连通且所述沟槽底部开口尺寸大于所述初始通孔顶部开口尺寸;
对所述初始通孔底部和初始开口底部的刻蚀阻挡层进行过刻蚀工艺,在器件区域介质层内形成露出所述底层金属互连结构的通孔,在外围区域介质层内形成露出所述底层金属互连结构的第二开口;其中,所述沟槽底部和所述通孔顶部相连通构成第一开口,且所述沟槽底部开口尺寸大于所述通孔顶部开口尺寸。
6.如权利要求5所述的半导体结构的形成方法,其特征在于,所述主刻蚀工艺和所述过刻蚀工艺均为等离子干法刻蚀工艺。
7.如权利要求6所述的半导体结构的形成方法,其特征在于,所述主刻蚀工艺的工艺参数包括:刻蚀气体为CF4、CHF3、CH2F2或C4F8,稀释气体为N2、O2、CO、He或Ar,所述刻蚀气体的气体流量为10sccm至200sccm,所述稀释气体的气体流量为10sccm至200sccm,腔室压强为30mTorr至200mTorr。
8.如权利要求6所述的半导体结构的形成方法,其特征在于,所述过刻蚀工艺的工艺参数包括:刻蚀气体为CF4、CHF3、CH2F2或C4F8,稀释气体为N2、O2、CO、He或Ar,所述刻蚀气体的气体流量为10sccm至2000sccm,所述稀释气体的气体流量为10sccm至2000sccm,腔室压强为30mTorr至1000mTorr。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造





