[实用新型]一种卫星导航ALTBOC信号复采样数据分析电路有效
| 申请号: | 201420757669.0 | 申请日: | 2014-12-05 |
| 公开(公告)号: | CN204215046U | 公开(公告)日: | 2015-03-18 |
| 发明(设计)人: | 邢兆栋;赵精博;刘春晓;支春阳 | 申请(专利权)人: | 中国电子科技集团公司第五十四研究所 |
| 主分类号: | G01S19/23 | 分类号: | G01S19/23;G05B19/042 |
| 代理公司: | 河北东尚律师事务所 13124 | 代理人: | 王文庆 |
| 地址: | 050081 河北省石家庄*** | 国省代码: | 河北;13 |
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| 摘要: | |||
| 搜索关键词: | 一种 卫星 导航 altboc 信号 采样 数据 分析 电路 | ||
技术领域
本实用新型涉及一种ALTBOC信号采样数据分析电路,尤其是一种卫星导航ALTBOC(15,10)信号复采样数据分析电路,属于卫星导航测试技术领域。
背景技术
ALTBOC(Alternate Binary Offset Carrier)是卫星导航系统的一种新体制信号,具有良好应用前景。目前,该信号体制已被GALILEO系统的E5频段采用,为ALTBOC(15,10)信号,其副载波速率为:15×1.023MHz,码速率为10×1.023MHz。
ALTBOC(15,10)卫星导航信号带宽宽,有利于抗多径和窄相关功能的发挥,可改善导航接收机测量精度。
ALTBOC(15,10)信号主瓣带宽为51.15MHz,加上旁瓣信号约70MHz,比常用的GPS L1频点信号的2.046MHz大很多。该信号具有性能优势,但接收处理难度大。
ALTBOC(15,10)信号的相关函数具有模糊性。对该信号的接收处理研究,主要是围绕捕获和跟踪两个方面开展。
对该信号开展实物验证测试研究,需要的硬件成本代价大。目前,通常采用高采样速率的AD转换器进行带通采样,并需要高性能的FPGA进行处理。若采用单边带信号接收,即20.46MHz信号带宽,虽可降低AD采样率及FPGA性能需求,但会造成约3dB能量损失,且未发挥该信号的性能优势。
针对上述问题,以发挥ALTBOC(15,10)信号优势的接收处理算法为目标,本实用新型给出了一种基于复采样的ALTBOC(15,10)的数据分析电路。采用双通道高集成AD转换器,消除基带硬件I/Q不平衡隐患,实现了处理全边带信号时采样速率降低一半,减轻了FPGA处理压力;并结合FPGA功能,可实现AD数据采集输出、单FPGA接收处理功能,支持ALTBOC(15,10)信号处理算法研究。
实用新型内容
本实用新型要解决的技术问题是提供一种卫星导航ALTBOC信号复采样数据分析电路。
为解决上述技术问题,本实用新型所采取的技术方案是:
一种卫星导航ALTBOC信号复采样数据分析电路,包括转换电路1、转换电路2、AD转换电路、FPGA电路和串口电路;所述转换电路1的相应输入端分别作为ALTBOC信号I和ALTBOC信号Q输入端,其输出端接所述AD转换电路的相应输入端;所述转换电路2的输入端接所述FPGA电路的相应输出端,其输出端接所述AD转换电路的相应输入端;所述FPGA电路的相应输出端接所述AD转换电路的输出端,其相应输出端接所述串口电路的输入端。
所述转换电路1由结构相同的ALTBOC信号I转换电路和ALTBOC信号Q转换电路组成;所述ALTBOC信号I转换电路的输入端作为所述转换电路1的ALTBOC信号I输入端,其输出端分别接所述AD转换电路的VIN+A和VIN-A输入端;所述ALTBOC信号Q转换电路的输入端作为所述转换电路1的ALTBOC信号Q输入端,其输出端分别接所述AD转换电路的VIN+B和VIN-B输入端;所述ALTBOC信号I转换电路由射频变压器U1、电阻R1、R3、R5、R7、R9、R11、R13、R15、电容C1、C3、C5、C7、C9、C11、C13组成;所述射频变压器U1的1脚依次经电阻R3、电容C1接ALTBOC信号I输入端,其2脚经电容C3接地,其3脚经电阻R1接所述ALTBOC信号I输入端的同时接地,其4脚依次经电阻R7、电容C13、电阻R15接VIN-A输出端,其6脚依次经电阻R5、电容C11、电阻R13接VIN+A输出端;电阻R9和电容C5串联后一端接电阻R5和电容C11间的结点,其另一端接地;电阻R11和电容C9串联后一端接电阻R7和R111间的结点,其另一端接地;电容C7一端接电阻R5和电容C11间的结点,其另一端接接电阻R7和R11间的结点。
所述转换电路2包括射频变压器U3、电阻R17-18、电容C15-C18;所述射频变压器U3的1脚依次经电阻R15、电容C15接所述FPGA电路的CLK输出端,其2脚经电容C16接地,其3脚经电阻R17接所述FPGA电路的CLK输入端的同时接地,其4脚和6脚分别经电容C18和C17接AD转换电路的CLK+和CLK-输入端。
所述串口电路包括串口芯片U6、电容C19-C22;所述串口芯片U6的2脚经电容C19接其4脚,其5脚经电容C20接其6脚,其3脚和7脚分别经电容C21和C22接地,其11脚和12脚接所述FPGA电路的相应输出端,其8脚和9脚作为所述卫星导航ALTBOC信号复采样数据分析电路的输出端。
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