[发明专利]多接口智能信道编解码数据转发收器在审
| 申请号: | 201410808932.9 | 申请日: | 2014-12-24 |
| 公开(公告)号: | CN105790884A | 公开(公告)日: | 2016-07-20 |
| 发明(设计)人: | 张志明;吴红生;宋勇辉;孔迎飞;何国辉;刘冰冰;戴吉 | 申请(专利权)人: | 中国航天科工集团八五一一研究所 |
| 主分类号: | H04L1/00 | 分类号: | H04L1/00 |
| 代理公司: | 南京理工大学专利中心 32203 | 代理人: | 朱显国 |
| 地址: | 210007*** | 国省代码: | 江苏;32 |
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| 摘要: | |||
| 搜索关键词: | 接口 智能 信道 解码 数据 转发 | ||
技术领域
本发明属于电子信息领域的物联网技术应用,具体涉及一种多接口智能信道编解码数据转发收器。
背景技术
多接口智能信道编解码数据转发器是一种专门用于物联网领域的智能数据传输设备。目前,物联网的应用已涉及国民生活的方方面面。从智能安防到智能电网,从二维码普及到“智慧城市”建设等,物联网正在悄悄改变人们的生活,逐渐成为新兴产业。物联网不是孤立的技术,从信息采集、传输、处理到反馈的过程构成一个闭合的回路,其中将会涉及RFID、传感器等构成的物联网络,WIFI、3G、互联网等构成的信息传输体系,云计算、大数据等信息处理技术,以及执行反馈信息的终端等多个环节。
可见,物联网技术的核心是大量分布组网式的数据集中传输到中央服务器,然后进行数据处理,并给出相应的反馈信息。所以,大量的分布式数据的传输是其重要的环节。如何保证数据可靠稳定的传输已成为物联网技术首要解决的问题。
物联网领域的数据传输归结起来主要有三类。一种是采用485总线方式或移动无线通信方式将分布式数据通过转接器接收,然后通过网络上传到中央数据库;另一种是通过电力载波通信中转后再由网络上传到中央数据库。目前,市场上已经有相对成熟的采用上述技术的数据收发设备,但随着物联网技术的发展及普及应用,数据传输暴露出越来越多的问题或不足,主要表现为设备抗干扰能力差,数据传输方式采用单一的透明传输,没有数据校验及纠错措施,误码率较高;此外,设备接口方式及功能单一,不具备一定的智能性,稳定性较差。
对于应用于物联网领域的数据收发设备来说,因其与网络连接,测量节点多,其稳定性、智能性、成本等指标显得至关重要。其中影响稳定性的因素较多,环境影响、硬件平台自身性能的影响、软件算法的影响等各个方面,其中控制软件的智能性是其关键。
发明内容
本发明的目的在于提供一种多接口智能信道编解码数据转发收器,针对数据传输的误码率问题,通过信道检错纠错算法,保障其数据可靠稳定,为现代物联网数据传输系统提供可靠、实用的智能数据收发设备,为现代物联网科学管理提供实时、可靠的各种数据。
实现本发明目的的技术解决方案为:一种多接口智能信道编解码数据转发器,包括由供电模块、传输模块、ARM处理器模块、网络传输模块、内部存储模块、无线传输模块、扩展存储模块;其中供电模块分别与传输模块、ARM处理器模块、网络传输模块、内部存储模块、无线传输模块和扩展存储模块相连,提供传输模块、ARM处理器模块、网络传输模块、内部存储模块、无线传输模块、扩展存储模块所需电源,ARM处理器模块完成数据接收、发送、信道编解码、数据存储以及设备控制,ARM处理器模块分别与传输模块和无线传输模块相连,完成对传输模块和无线传输模块的参数设置,同时接收传输模块的数据;ARM处理器模块与网络传输模块相连,完成对网络传输模块的参数设置,同时通过网络传输模块将数据送出;ARM处理器模块与内部存储模块和扩展存储模块相连,完成数据的存储,其中内部存储模块和扩展存储模块均为设备外置模块,可根据用户需求进行选配。
上述ARM处理器模块包括数据接收模块、控制模块、信道编解码模块、数据发送模块;数据接收模块与控制模块相连,控制模块控制数据接收模块接收数据;控制模块与信道编解码模块相连,信道编解码模块在控制模块的控制下对数据接收模块接收的数据进行CRC校验、RS纠错编解码;控制模块与数据发送模块相连,控制模块对数据发送模块进行控制,通过数据发送模块将完成编解码处理后的数据发送。
本发明与现有技术相比,其显著优点:(1)对于产品稳定性,首先采用了信道检错、纠错算法,数据的误码率大大降低;其次因增加了网络通信异常时数据自动存储功能,所以数据的实时性及完整性得以保证;此外因采用485总线和无线方式传输数据,可适用多种复杂环境。
(2)算法采用CRC、和校验等数据检错方式,同时采用RS纠错编解码方式,大大降低了数据传输的误码率。
(3)采用智能嵌入式ARM处理器实现,接口灵活,集成度高。
(4)设备智能性高,具有系统自检、纠错失败时重新读取、故障自动重启、网络通信中断的自动数据存储等功能。
附图说明
图1是本发明结构示意图。
图2是本发明的ARM处理器模块的结构示意图。
图3是本发明实际组网使用场景示意图。
具体实施方式
下面结合附图对本发明作进一步详细描述。
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