[发明专利]数据处理设备和控制方法在审
| 申请号: | 201410071667.0 | 申请日: | 2014-02-28 |
| 公开(公告)号: | CN104021095A | 公开(公告)日: | 2014-09-03 |
| 发明(设计)人: | 君岛裕一郎 | 申请(专利权)人: | 佳能株式会社 |
| 主分类号: | G06F13/16 | 分类号: | G06F13/16 |
| 代理公司: | 北京魏启学律师事务所 11398 | 代理人: | 魏启学 |
| 地址: | 日本东京都大*** | 国省代码: | 日本;JP |
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| 摘要: | |||
| 搜索关键词: | 数据处理 设备 控制 方法 | ||
1.一种数据处理设备,包括:
处理部件,用于经由具有第一数据宽度的第一总线输出用于对存储器装置写入数据的第一访问请求;
连结部件,用于通过对经由所述第一总线从所述处理部件输出的多个所述第一访问请求进行连结来生成一个第二访问请求,并且输出所述第二访问请求;
控制部件,用于设置所述连结部件执行用于生成一个所述第二访问请求的连结处理的时间段,并且对所述连结部件进行控制,以使得对在一个所述时间段内输出的多个所述第一访问请求进行连结;以及
存储器控制部件,用于经由具有比所述第一数据宽度大的第二数据宽度的第二总线来控制针对所述存储器装置的访问,
其中,所述存储器控制部件接收从所述连结部件输出的所述第二访问请求,并且将所述第二访问请求经由所述第二总线输出至所述存储器装置。
2.根据权利要求1所述的数据处理设备,其中,
所述控制部件对所述连结部件进行控制,以使得不对在一个所述时间段内输出的所述第一访问请求和在另一所述时间段内输出的所述第一访问请求进行连结。
3.根据权利要求1所述的数据处理设备,其中,
所述控制部件设置所述时间段,以使得在从所述处理部件输出所述第一访问请求起、直到请求读出根据所述第一访问请求而写入所述存储器装置的数据为止的间隔内,将所述第二访问请求输出至所述存储器装置。
4.根据权利要求1所述的数据处理设备,其中,
所述控制部件设置通过从第一时间段中减去第二时间段所获得的第三时间段,作为要执行所述连结处理的时间段,其中所述第一时间段是从所述处理部件输出所述第一访问请求起、直到请求读出根据所述第一访问请求而写入所述存储器装置的数据为止的时间段,以及所述第二时间段是从所述存储器控制部件向所述存储器装置输出访问请求起、直到接受所述访问请求为止的时间段。
5.根据权利要求4所述的数据处理设备,其中,还包括:
多个其它处理部件,用于分别输出针对所述存储器装置的访问请求,
其中,所述第三时间段是根据同时输出针对所述存储器装置的访问请求的所述其它处理部件的数量来确定的。
6.根据权利要求4所述的数据处理设备,其中,
所述存储器装置包括保持部件,所述保持部件用于保持经由所述第二总线所接收到的访问请求,以及
所述第三时间段是根据所述保持部件所保持的访问请求的数量来确定的。
7.根据权利要求1所述的数据处理设备,其中,
所述控制部件对所述连结部件进行控制,以使得在第一模式下,执行针对所述第一访问请求的连结处理,并且在第二模式中,不执行针对所述第一访问请求的连结处理。
8.根据权利要求7所述的数据处理设备,其中,
所述控制部件响应于针对所述存储器装置的传送所使用的所述第二总线的带宽来切换所述第一模式和所述第二模式。
9.根据权利要求1所述的数据处理设备,其中,在判断为由在一个所述时间段内从所述处理部件连续输出的两个所述第一访问请求指定的地址不连续的情况下,所述连结部件不对该连续输出的两个所述第一访问请求进行连结。
10.根据权利要求9所述的数据处理设备,其中,
所述第一访问请求包括写入开始地址和要写入的数据的数据长度,以及
所述连结部件通过将连续输出的两个所述第一访问请求中的先输出的所述第一访问请求的写入开始地址和后输出的所述第一访问请求的写入开始地址之间的差、与先输出的所述第一访问请求的数据长度进行比较,来判断由该连续输出的两个所述第一访问请求指定的地址是否连续。
11.一种数据处理设备的控制方法,包括以下步骤:
处理步骤,用于经由具有第一数据宽度的第一总线输出用于对存储器装置写入数据的第一访问请求;
连结步骤,用于通过对经由所述第一总线在所述处理步骤中输出的多个所述第一访问请求进行连结来生成一个第二访问请求,并且输出所述第二访问请求;
控制步骤,用于设置所述连结步骤执行用于生成一个所述第二访问请求的连结处理的时间段,并且对所述连结步骤的操作进行控制,以使得对在一个所述时间段内输出的多个所述第一访问请求进行连结;以及
存储器控制步骤,用于经由具有比所述第一数据宽度大的第二数据宽度的第二总线来控制针对所述存储器装置的访问,
其中,在所述存储器控制步骤中,接收在所述连结步骤中输出的所述第二访问请求,并且将所述第二访问请求经由所述第二总线输出至所述存储器装置。
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