[发明专利]在异质衬底上制造半导体结构的方法有效
| 申请号: | 201380081120.2 | 申请日: | 2013-12-23 |
| 公开(公告)号: | CN105745769B | 公开(公告)日: | 2019-02-22 |
| 发明(设计)人: | B·舒-金;S·R·塔夫脱;V·H·勒;S·达斯古普塔;S·H·H·宋;S·K·加德纳;M·V·梅茨;M·拉多萨夫列维奇;H·W·田 | 申请(专利权)人: | 英特尔公司 |
| 主分类号: | H01L33/00 | 分类号: | H01L33/00 |
| 代理公司: | 永新专利商标代理有限公司 72002 | 代理人: | 陈松涛;韩宏 |
| 地址: | 美国加*** | 国省代码: | 美国;US |
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| 摘要: | |||
| 搜索关键词: | 衬底 制造 半导体 结构 方法 | ||
1.一种形成半导体结构的方法,包括:
在衬底上形成包括第一层、第二层和第三层的掩模;
所述第一层具有暴露所述衬底的顶部表面的第一开口,所述第一开口具有第一宽度和第一侧壁;
所述第二层具有暴露所述衬底的所述顶部表面以及所述第一层的顶部表面的第二开口,所述第二开口具有第二宽度和第二侧壁,所述第二宽度大于所述第一宽度;并且
所述第三层具有暴露所述衬底的所述顶部表面的第三开口,所述第三开口具有第三宽度和第三侧壁,其中,所述第一开口、所述第二开口和所述第三开口以公共中心轴为中心;
从所述衬底的所述顶部表面生长半导体材料,并且横向地生长至所述第一层的所述顶部表面上;以及
通过将所述第三层用作为蚀刻掩模,来蚀刻被布置在所述第三开口内并且在所述第三开口的垂直下方的所述半导体材料,以使得横向地溢出至所述第一层的所述顶部表面上的所述半导体材料形成保留结构。
2.根据权利要求1所述的方法,其中,在衬底上形成包括第一层、第二层和第三层的所述掩模包括:
将所述第一层、所述第二层和所述第三层沉积在所述衬底上,所述第二层形成在所述第一层上方并且在所述第三层下方;
形成通过所述第一层、所述第二层和所述第三层的初始开口;以及
利用对所述第一层和所述第三层具有选择性的蚀刻工艺,从所述初始开口内蚀刻所述第二层。
3.根据权利要求1所述的方法,还包括:
去除所述第二层和所述第三层;
将电介质材料均厚沉积在所述衬底的所述顶部表面、所述第一层的所述顶部表面、所述第一侧壁以及所述保留结构的暴露的表面上;以及
将所述电介质材料平坦化至所述保留结构的顶部表面。
4.根据权利要求3所述的方法,还包括:去除所述电介质材料的一部分,以暴露所述保留结构的顶部表面以及所述保留结构的两个相对侧壁的一部分。
5.根据权利要求3所述的方法,其中,所述平坦化形成所述保留结构上的平坦的顶部表面。
6.根据权利要求1所述的方法,其中,所述半导体材料包括III-V半导体材料中的至少一种元素。
7.根据权利要求1所述的方法,其中,所述半导体材料包括镓、氮、锗和硅中的至少一种元素。
8.根据权利要求7所述的方法,其中,所述半导体材料包括GaN。
9.根据权利要求7所述的方法,其中,所述半导体材料包括SiGe。
10.根据权利要求1所述的方法,其中,所述衬底包括硅。
11.根据权利要求1所述的方法,其中,所述第一层、所述第二层和所述第三层是金属层。
12.根据权利要求1所述的方法,其中,所述第一层、所述第二层和所述第三层是电介质层。
13.根据权利要求12所述的方法,其中,所述第二层包括与所述第一层和所述第三层的材料不同的材料。
14.根据权利要求13所述的方法,其中,所述第二层能够相对于所述第一层和所述第三层被选择性地蚀刻。
15.根据权利要求14所述的方法,其中,所述第二层包括氮化硅,并且所述第一层和所述第三层包括二氧化硅。
16.根据权利要求1所述的方法,其中,蚀刻所述半导体材料的是各向异性的蚀刻工艺。
17.根据权利要求1所述的方法,其中,所述第三宽度等于所述第一宽度。
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