[发明专利]一种基于标准PCIe上行端口的IO扩展架构方法有效
| 申请号: | 201310113269.6 | 申请日: | 2013-04-02 |
| 公开(公告)号: | CN103176930A | 公开(公告)日: | 2013-06-26 |
| 发明(设计)人: | 吴新军;丁琳;韩娇;罗茂盛;卢姝颖;吴志勇;欧阳伟 | 申请(专利权)人: | 无锡江南计算技术研究所 |
| 主分类号: | G06F13/20 | 分类号: | G06F13/20 |
| 代理公司: | 北京众合诚成知识产权代理有限公司 11246 | 代理人: | 龚燮英 |
| 地址: | 214083 江苏*** | 国省代码: | 江苏;32 |
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| 摘要: | |||
| 搜索关键词: | 一种 基于 标准 pcie 上行 端口 io 扩展 架构 方法 | ||
1.一种用于申威处理器的基于标准PCIe上行端口的IO扩展架构方法,其特征在于包括:
进行分层多级总线扩展,其中多级总线的根在于申威处理器的标准PCIe接口,处理器提供带外的串口,按照总线带宽的高低确定总线离处理器的远近,将BIOS芯片挂在最远的地方;
执行申威处理器硬件的初始配置、并初始执行代码,通过带外串口注入到申威处理器的内部寄存器和指令高速缓存中,完成处理器的启动配置,使处理器执行启动代码;
通过申威处理器的初始执行代码完成存控的训练和主存的初始化,并通过一次PCI设备深度优先的枚举操作,完成申威处理器到BIOS访问通路的构建。
2.根据权利要求1所述的基于标准PCIe上行端口的IO扩展架构方法,其特征在于还包括:将传统设备挂接在离处理器最远的总线上,通过各级总线仲裁优先级的配置。
3.根据权利要求1或2所述的基于标准PCIe上行端口的IO扩展架构方法,其特征在于,初始执行代码内含PCI设备枚举功能,用于将传统I/O空间分配给首个下一级总线。
4.根据权利要求1或2所述的基于标准PCIe上行端口的IO扩展架构方法,其特征在于,带外串口采用同步的物理层,且时钟和数据的相位关系在系统端可配,链路层以包的形式传输,请求和响应之间没有严格的时序要求。
5.根据权利要求4所述的基于标准PCIe上行端口的IO扩展架构方法,其特征在于,链路层的包的传输是连续,不可暂停,以特定的命令码和响应码标识包的开始和长度。
6.根据权利要求1或2所述的基于标准PCIe上行端口的IO扩展架构方法,其特征在于还包括:使中断使用一个特定的命令码和包格式,以包的方式传递给处理器。
7.根据权利要求1或2所述的基于标准PCIe上行端口的IO扩展架构方法,其特征在于还包括:增强或弱化其中的某级总线挂接设备的能力。
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