[发明专利]存取存储器单元的方法、分配存储器请求的方法、系统及存储器控制器有效
| 申请号: | 201280019658.6 | 申请日: | 2012-03-06 |
| 公开(公告)号: | CN103493026B | 公开(公告)日: | 2017-02-15 |
| 发明(设计)人: | 罗伯特·沃克尔 | 申请(专利权)人: | 美光科技公司 |
| 主分类号: | G06F12/02 | 分类号: | G06F12/02;G06F13/14;G06F13/16 |
| 代理公司: | 北京律盟知识产权代理有限责任公司11287 | 代理人: | 孙宝成 |
| 地址: | 美国爱*** | 国省代码: | 暂无信息 |
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| 摘要: | |||
| 搜索关键词: | 存取 存储器 单元 方法 分配 请求 系统 控制器 | ||
优先权申请
本专利申请案主张2011年3月7日提出申请的第13/042,164号美国申请案的优先权权益,所述美国申请案以全文引用的方式并入本文中。
技术领域
背景技术
存储器系统用于例如个人数字助理(PDA)、膝上型计算机、移动电话及数码相机的许多装置中。这些存储器系统中的一些存储器系统包含接收来自单个总线的存储器请求的多个存储器装置。
发明内容
附图说明
在附图的图中以实例方式而非限制方式图解说明一些实施例,附图中:
图1是根据本发明的各种实施例的系统的框图;
图2是根据本发明的各种实施例的系统的框图;
图3是根据本发明的各种实施例的存储器系统的框图;
图4是根据本发明的各种实施例的存储器单元的地址的框图;
图5是根据本发明的各种实施例的可编程寄存器的框图;
图6是根据本发明的各种实施例的存储器单元的地址的框图;
图7是根据本发明的各种实施例的存储器单元的地址的框图;
图8是图解说明根据本发明的各种实施例的由存储器系统接收的数据的示意图;
图9是图解说明根据本发明的各种实施例由存储器系统接收的数据的示意图;
图10是根据本发明的各种实施例的系统的框图;
图11是根据本发明的各种实施例的一种方法的流程图;
图12是根据本发明的各种实施例的一种方法的流程图;且
图13是根据本发明的各种实施例的存储器单元的地址的框图。
具体实施方式
当与其它系统相比时,多通道存储器系统具有更大带宽及经减少的功率使用。在一些系统中,每一通道服务一主装置或主装置群组。此指派允许更严格的服务控制的质量,但可减少可从存储器系统获得的带宽。当主装置休眠时,相关联通道的引脚及带宽为闲置的且不能被所述系统的其余部分使用。指派给主装置或主装置群组的每一通道的存储器密度也可受限制。例如,如果主装置仅需要128个千字节(KB)的存储器,且最小可用通道提供一个千兆字节(GB)的存储器,那么所述通道的大部分将不可用,因为整个通道被指派给所述主装置。
发明人已发现,可通过操作具有多个存储器单元区域的存储器系统来解决上述的挑战以及其它挑战,其中每一区域具有(例如)其自己的通道定义。区域性通道定义使得能够配置(例如,调谐)存储器系统的功率使用及性能。
在以下描述中,个别数字(例如,下文中被称为“位”的二进制数字)表示在括号内。一将单个位表示为位[G],其中G是0以上的非负整数。将连续位群组表示为位[J:K],其中J及K是非负整数。[J:K]中的连续位以K开始且以J结束。一字节具有八个位,且由B[P]表示,其中P是识别所述字节的非负整数。
图1是根据本发明的各种实施例的系统100的框图。系统100包含通过第一总线130耦合到桥接电路120的第一处理器110。第二处理器134也通过第一总线130耦合到桥接电路120。桥接电路120通过第二总线150耦合到存储器系统140。桥接电路120借助存储器控制器160执行来自处理器110及处理器134的存储器请求,且经由第一总线130及第二总线150在处理器110及处理器134与存储器系统140之间传送数据。存储器系统140中的存储器单元是根据存储器控制器160中的存储器映射170来定位。可将存储器系统140中的存储器单元划分(例如,分割)为例如第一区域182及第二区域184的多个区域。存储器系统140可包含(例如)一个或一个以上动态随机存取存储器(DRAM)装置、同步动态随机存取存储器(SDRAM)装置及快闪存储器装置。处理器110及134可称为主装置,且系统100中可存在两个以上主装置。
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