[发明专利]电子机器有效

专利信息
申请号: 201010624147.X 申请日: 2010-12-29
公开(公告)号: CN102157191A 公开(公告)日: 2011-08-17
发明(设计)人: 若狭贵博 申请(专利权)人: 精工爱普生株式会社
主分类号: G11C11/406 分类号: G11C11/406
代理公司: 北京集佳知识产权代理有限公司 11227 代理人: 王轶;舒艳君
地址: 日本*** 国省代码: 日本;JP
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摘要:
搜索关键词: 电子 机器
【说明书】:

技术领域

本发明涉及电子机器。

背景技术

DRAM(Dynamic RAM,动态随机存储器)若一定时间不进行存取,则其存储内容就会消失,所以需要按照一定周期更新存储内容(以下,称为“刷新”)(专利文献1等)。例如,在给定时间(64ms)以内对构成DRAM的所有单元(存储区域)进行刷新的情况下,对DRAM进行控制的控制器,必须以平均7.8μs对DRAM发行一次刷新命令(单元数或列数为8192)。

然而,并不是一定要在7.8μs以内刷新一次,只要最终能够在给定期间(64ms)以内刷新所有单元,则刷新的间隔是自由的。以下,将以等间隔进行刷新的情况称为“分布式刷新”、将以短于分布式刷新的时间进行集中式刷新的情况称为“集中式刷新”。

专利文献1:日本特开2007-233633号

但是,上述的刷新所需的时间较长,在这期间不能对DRAM进行存取,因此由于刷新时刻而对DRAM的性能(performance)造成大的影响。

发明内容

本发明的目的在于提供一种基于刷新来防止DRAM的性能下降的技术。

为了解决上述课题,本申请发明是具备控制DRAM的存储器控制电路的电子机器,上述存储器控制电路进行如下处理:第一分布式刷新处理,按照对构成上述DRAM的存储元件在给定期间Ts内至少刷新一次的方式,并以给定间隔对上述DRAM发行刷新命令;集中式刷新处理,以对 上述DRAM发出给定的请求为契机,以比上述给定间隔短的间隔且以给定次数Nc集中发行上述刷新命令;第二分布式刷新处理,如果上述给定次数Nc的刷新命令的发行结束,则算出用于对在上述给定期间Ts内尚未进行刷新的剩余的存储元件进行刷新的刷新间隔Tr,并以算出的该刷新间隔Tr发行上述刷新命令。

附图说明

图1为表示应用了本发明一实施方式的图像处理装置100的硬件结构的一个例子的图。

图2为表示存储器控制ASIC130的硬件结构的一个例子的图。

图3为表示(A)分布式刷新模式中的刷新命令的发行时刻的一个例子、(B)集中式刷新模式中的刷新命令的发行时刻的一个例子、(C)并用模式中的刷新命令的发行时刻的例子的图。

图4为表示刷新模式的设定处理的流程图。

图5为用于说明集中式刷新模式的设定方法的图,是将给定区间Ts分割为6个情况下的例子,1为给定区间Ts的时间(例:64ms)、2为给定区间Ts的刷新次数Ns(例:8192次)、3为集中式刷新区域的设定(例如:区域2)、◇为刷新命令发行。

图6为用于说明并用刷新模式的设定方法的图,1为集中式刷新触发的设定(例:A的请求发生时)、2为给定区间Ts的时间(例:64ms)、3为给定区间Ts的刷新次数Ns(例:8192次)、4为集中式刷新发生为止的刷新间隔(例:7.8μs)、5为集中式刷新次数Nc(例:5次)、◇为刷新命令发行。

附图标记说明:100...图像处理装置;110...控制器;120...CPU;130...存储器控制 ASIC;131...接口部;132...仲裁电路;133...存储器控制器;140...SDRAM;150...I/O控制ASIC;160...引擎部;170...操作面板;200...信息处理装置。

具体实施方式

以下,参照附图对本发明的实施方式的一例子进行说明。

图1为表示应用了本发明一实施方式的图像处理装置100的硬件结构的一例子的图。图像处理装置100为打印机、复印机、复合机、扫描机等装置。图像处理装置100与信息处理装置200连接。

信息处理装置200是用具备未图示的CPU、RAM、ROM、硬盘等辅助存储装置、显示器、键盘或鼠标等输入装置、通信接口等一般的计 算机来实现的。在信息处理装置200中,执行应用程序、驱动程序(例如,打印驱动程序)。

图像处理装置100具备:控制器110,其作为电子机器控制装置对图像处理装置100中的各种处理进行控制;引擎部160,其对印刷介质进行印刷及对原稿进行读取;以及操作面板170,其是与用户之间的输入输出接口。

控制器110具备CPU120、存储器控制ASIC130、SDRAM140、I/0(Input/Output)控制ASIC150。控制器110对引擎部160、操作面板170等各种机构进行控制,实现包含各种图像处理等的印刷功能、传真功能、扫描功能、复印功能等。然而,控制器110不限于此,例如可以将CPU120内设于存储器控制ASIC130。

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