[发明专利]利用纠错码和同步信息的数据行存储及传输有效
| 申请号: | 201010591456.1 | 申请日: | 2010-12-09 |
| 公开(公告)号: | CN102096610A | 公开(公告)日: | 2011-06-15 |
| 发明(设计)人: | R·阿加瓦尔;C·S·胡德莱斯顿 | 申请(专利权)人: | 英特尔公司 |
| 主分类号: | G06F11/10 | 分类号: | G06F11/10 |
| 代理公司: | 中国专利代理(香港)有限公司 72001 | 代理人: | 柯广华;王洪斌 |
| 地址: | 美国加利*** | 国省代码: | 美国;US |
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| 摘要: | |||
| 搜索关键词: | 利用 纠错码 同步 信息 数据 存储 传输 | ||
1.一种方法,包括:
使用纠错码对数据块进行编码,其中所得编码每32个数据符号包括三个校验符号;
生成与所述数据符号对应的至少一个同步符号;
组合所述数据符号、所述校验符号和所述至少一个同步符号;
传送已组合的所述数据符号、所述校验符号和所述至少一个同步符号。
2.如权利要求1所述的方法,其中,所述纠错码包括经修改的里德-索罗蒙码。
3.如权利要求1所述的方法,其中,每个符号包括一个或多个字节。
4.如权利要求1所述的方法,其中,所述数据块包括高速缓存行,其中包含32个数据符号、三个校验符号和一个同步符号。
5.如权利要求1所述的方法,其中,已组合的所述数据符号、所述校验符号和所述至少一个同步符号被传送至一个或多个双列直插存储器模块(DIMM)并且存储在其中。
6.一种设备,包括:
第一处理器;
第二处理器,所述第二处理器与所述第一处理器耦合,以便与所述第一处理器并行操作,所述第二处理器使用纠错码对数据块进行编码,其中所得编码每32个数据符号包括三个校验符号;生成与所述数据符号对应的至少一个同步符号,用于所述第二处理器与所述第一处理器之间的同步;组合所述数据符号、所述校验符号和所述至少一个同步符号;以及将已组合的所述数据符号、所述校验符号和所述至少一个同步符号传送给所述第一处理器。
7.如权利要求6所述的设备,其中,所述纠错码包括经修改的里德-索罗蒙码。
8.如权利要求6所述的设备,其中,每个符号包括一个或多个字节。
9.如权利要求6所述的设备,其中,所述数据块包括高速缓存行,其中包含32个数据符号、三个校验符号和一个同步符号。
10.如权利要求6所述的设备,其中,已组合的所述数据符号、所述校验符号和所述至少一个同步符号被传送至一个或多个双列直插存储器模块(DIMM)并且存储在其中。
11.一种包括计算机可读介质的产品,在所述计算机可读介质上存储了指令,所述指令在被执行时使一个或多个处理器:
使用纠错码对数据块进行编码,其中所得编码每32个数据符号包括三个校验符号;
生成与所述数据符号对应的至少一个同步符号;
组合所述数据符号、所述校验符号和所述至少一个同步符号;
传送已组合的所述数据符号、所述校验符号和所述至少一个同步符号。
12.如权利要求11所述的产品,其中,所述纠错码包括经修改的里德-索罗蒙码。
13.如权利要求11所述的产品,其中,每个符号包括一个或多个字节。
14.如权利要求11所述的产品,其中,所述数据块包括高速缓存行,其中包含32个数据符号、三个校验符号和一个同步符号。
15.如权利要求11所述的产品,其中,已组合的所述数据符号、所述校验符号和所述至少一个同步符号被传送至一个或多个双列直插存储器模块(DIMM)并且存储在其中。
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