[发明专利]数字预失真处理电路、方法、功率放大装置及直放站无效

专利信息
申请号: 201010137329.4 申请日: 2010-03-26
公开(公告)号: CN101808062A 公开(公告)日: 2010-08-18
发明(设计)人: 刘东辉 申请(专利权)人: 深圳市云海通讯股份有限公司
主分类号: H04L25/49 分类号: H04L25/49;H03F1/32
代理公司: 深圳中一专利商标事务所 44237 代理人: 张全文
地址: 518048 广东省深圳市福田区*** 国省代码: 广东;44
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摘要:
搜索关键词: 数字 失真 处理 电路 方法 功率 放大 装置 直放站
【说明书】:

技术领域

发明属于通信领域,尤其涉及一种数字预失真处理电路、方法、实现数 字预失真的装置、功率放大装置及直放站。

背景技术

功率放大器(Power Amplifier,PA)是通信领域的关键器件,也是最主要的 非线性器件;PA具有幅度或相位失真性。PA的效率和失真是相互对立的,为 了使PA的效率和预失真度均满足指标,采用数字预失真技术来改善PA的线性 度具有稳定、高效、带宽与自适应等特点。数字预失真技术的核心是在PA前 串联一个函数模块,该函数模块使得经过PA的信号发生畸变,这个畸变能够 抵消PA的非线性对信号产生的畸变。在理想的情况下,由数字预失真(digital  Predistortion,DPD)和PA所组成系统的输入输出关系是线性的。

发明内容

本发明实施例的目的在于提供一种可以改善信道的相邻抑制比,提高功放 电路的线性度的数字预失真处理电路。

本发明实施例是这样实现的,一种数字预失真处理电路,包括:

延时调整对齐模块,其第一输入端接收主路信号,第二输入端接收功放电路 输出的反馈路信号,进行相关运算后使得所述主路信号与所述反馈路信号的时 序相一致;

算法模块,其第一输入端接收所述主路信号,第二输入端接收经过延时调整 后与所述主路信号对齐的反馈路信号,根据公式进 行最小二乘法运算后输出滤波器系数,y(n)表示功放电路输出的反馈路信号, z(n)表示预失真数字信号,K表示多项式的项数,Q表示最大延迟,akq表示自 适应滤波器系数;

系数查找模块,其输入端连接至所述算法模块的输出端,所述系数查找模块 的输出端连接至所述自适应滤波器的反馈端;将所述滤波器系数进行数学查找 运算后输出加权系数;

自适应滤波器,其输入端接收外部输入的基带信号,将所述系数查找模块输 出的加权系数与所述外部输入的基带信号进行卷积运算后输出预失真数字信 号。

更进一步地,所述数字预失真处理电路还包括:

主路信号储存模块,其输入端连接至所述自适应滤波器的输出端,所述主路 信号储存模块的输出端分别连接至所述延时调整对齐模块的第一输入端和所述 算法模块的第一输入端;以及

反馈路信号储存模块,其输入端连接至所述功放电路的输出端,所述反馈路 信号储存模块的输出端连接至所述延时调整对齐模块的第二输入端。

本发明实施例的目的还在于提供一种数字预失真处理方法,包括下述步骤:

延时调整对齐模块将主路信号和功放电路输出的反馈路信号进行相关运算 后使得所述主路信号与所述反馈路信号的时序相一致;

算法模块将所述主路信号和经过延时调整后与所述主路信号对齐的反馈路 信号根据公式进行最小二乘法运算后输出滤波器 系数,y(n)表示功放电路输出的反馈路信号,z(n)表示预失真数字信号,K表示 多项式的项数,Q表示最大延迟,akq表示自适应滤波器系数;

系数查找模块将所述滤波器系数进行数学查找运算后输出加权系数;

自适应滤波器将所述系数查找模块输出的加权系数与所述外部输入的基带 信号进行卷积运算后输出预失真数字信号。

更进一步地,在算法模块进行最小二乘法运算步骤之前还包括下述步骤:

主路信号储存模块储存所述主路信号,反馈路信号储存模块储存所述功放电 路输出的反馈路信号。

本发明实施例的目的还在于提供一种实现数字预失真的装置,其包括:顺次 连接的数字预失真处理电路、数模转换模块和上变频模块;以及顺次连接的下 变频模块和模数转换模块;所述上变频模块的输出端连接至功放电路的输入端; 所述下变频模块的输入端连接至所述功放电路的输出端,所述模数转换模块的 输出端连接至所述数字预失真处理电路的反馈端;所述数字预失真处理电路包 括上述的数字预失真处理电路。

本发明实施例的目的还在于提供一种包括上述实现数字预失真的装置的功 率放大装置。

本发明实施例的目的还在于提供一种包括上述功率放大装置的直放站。

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