[发明专利]数字解调装置有效
| 申请号: | 200910152334.X | 申请日: | 2009-06-30 |
| 公开(公告)号: | CN101938327A | 公开(公告)日: | 2011-01-05 |
| 发明(设计)人: | 蔡金融;江政宪 | 申请(专利权)人: | 承景科技股份有限公司 |
| 主分类号: | H04L1/00 | 分类号: | H04L1/00;H04L27/00 |
| 代理公司: | 北京市柳沈律师事务所 11105 | 代理人: | 史新宏 |
| 地址: | 中国台*** | 国省代码: | 中国台湾;71 |
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| 摘要: | |||
| 搜索关键词: | 数字 解调 装置 | ||
技术领域
本发明涉及一种应用于时序误差检测的数字解调装置,特别是涉及一种应用于判断导向(decision-oriented)的时序误差检测的数字解调装置,其有能力计算出具有高精确性的时序误差序列信号。
背景技术
判断导向的时序误差检测(例如缪勒和穆勒(Mueller and Muller)时序误差检测)需要一已知的传送序列信号来估计所接收的输入序列信号的时序误差值。传统上,该传送序列信号是由一均衡器所决定并提供,这在一个多重通道或低信噪比(Signal-Noise Ratio,SNR)的环境中会产生高的错误率。如此一来,所估计/计算的时序误差值将会是不准确的。
发明内容
基于以上的考虑,需要一种可计算更精确的时序误差值的数字解调装置。
有鉴于此,本发明揭示一种数字解调装置,包括一数值控制振荡器、一均衡器单元、一译码器和一时序误差检测器。数值控制振荡器根据一输入序列信号和一时序误差序列信号产生一第一序列信号。均衡器单元将第一序列信号进行均衡的处理以产生一均衡序列信号。译码器将均衡序列信号译码以产生一输出序列信号。时序误差检测器根据第一序列信号,以及均衡序列信号和输出序列信号两者的其中之一,来产生时序误差序列信号。
此外,本发明还揭示一种数字解调装置,包括一数值控制振荡器、一均衡器单元、一译码器和一时序误差检测器。其中,均衡器单元包括一均衡器和一判断器。数值控制振荡器根据一输入序列信号和一时序误差序列信号产生一第一序列信号。均衡器根据一判断序列信号将第一序列信号进行均衡的处理,以产生一均衡序列信号。判断器根据一参考信号对均衡序列信号进行判断的处理,以产生判断序列信号。译码器将均衡序列信号译码,并于译码的期间产生一输出序列信号和参考信号。时序误差检测器根据第一序列信号,以及判断序列信号、均衡序列信号和输出序列信号三者的其中之一,来产生时序误差序列信号。
附图说明
图1显示根据本发明一实施例所述的数字解调装置的方块图;以及
图2显示根据本发明另一实施例所述的数字解调装置的方块图。
附图符号说明
10~数值控制振荡器
20~缓冲器
30~均衡器单元
40~译码器
50~时序误差检测器
100、200~数字解调装置
311~均衡器
312~判断器
具体实施方式
为使本发明的上述目的、特征和优点能更明显易懂,下文特举较佳实施例,并结合附图详细说明如下:
图1显示根据本发明一实施例所述的数字解调装置的方块图。用于时序误差检测的数字解调装置100包括一数值控制振荡器(Numerically Controlled Oscillator,NCO)10、一缓冲器(buffer)20、一均衡器单元(equalizer unit)30、一译码器(decoder)40以及一时序误差检测器(timing error detector)50。NCO 10接收一输入序列信号In,并产生一第一序列信号x(n)。其中,NCO 10的第一序列信号x(n)送至缓冲器20和均衡器单元30。缓冲器20用以当成第一序列信号x(n)的延迟补偿功能,并输出补偿的第一序列信号y(n)至时序误差检测器50。均衡器单元30可纯粹包括一均衡器(图未显示),用以去除输入序列信号In于信道传输中所产生的通道效应,并输出一均衡序列信号至译码器40。译码器40对均衡序列信号执行硬式判断(hard decision)的处理,以产生一输出序列信号a(n)给时序误差检测器50。根据缓冲器20所提供的补偿第一序列信号y(n)和译码器40所提供的输出序列信号a(n),时序误差检测器50可估计/计算出一时序误差序列信号e(n),并提供给NCO10来调整其所输出的第一序列信号x(n)。值得注意的是,时序误差检测器50亦可根据缓冲器20所提供的补偿第一序列信号y(n)和均衡器单元30所提供的均衡序列信号,来估计/计算时序误差序列信号e(n)并提供给NCO 10来调整其所输出的第一序列信号x(n)。译码器40可以是一维特比(Viterbi)译码器,但并不限定于此。时序误差序列信号e(n)可根据以下公式来计算:
e(n)=a(n-1)*y(n)-a(n)*y(n-1) (A)
其中,变量a(n-1)代表较目前输出序列信号a(n)更早的先前输出序列信号,变量y(n-1)亦是同理。
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